1樓:匿名使用者
記錄一bai下,我也遇到du了這個問題,解決辦法是這樣zhi的
2樓:匿名使用者
***list儲存路徑更改一下試看看。
3樓:匿名使用者
我想請問一下您是怎麼改的
你好,我想問一下,為什麼我在cadence匯入網表時出現這樣的錯誤,請問要如何解決呢?
4樓:懶人魚
從這份錯誤報告來看,有兩個錯誤:
1、有器件沒有對應的pcb封裝,這要檢視你的庫連結是否正確,pcb封裝名是否填對,如果沒有pcb封裝,需要做庫。
你可以用文字編輯器開啟env檔案(路徑在你home環境變數下的pcbenv資料夾下),檢查以下這幾行設定是否正確。
set padpath = d:\lib\pad ;;注:這指的是設定你的焊盤庫路徑
set p**path = d:\lib\p** ;;注:這指的是設定你的p**庫路徑
set devpath = d:\lib\dev ;;注:這指的是設定你的dev庫路徑
2、排除第一個錯誤後,再檢查下你的原理圖,管腳名是否有allegro不識別的非法字元,value有沒有allegro不識別的非法字元,如果是導第一方網表,可檢視log檔案:***list.log來定位是那個器件導網表有問題。
這是導網表常出現的錯誤,需望能幫到你!
5樓:匿名使用者
我之前也遇見這個問題了,搞了好長時間才解決。如果庫路徑和環境變數都弄好了的話,是你的軟體版本低了。你可以打補丁或者安裝更高的版本,問題就解決了。
打補丁的話,網上有教程。實測有效。
6樓:匿名使用者
首先我想問你,你配置好元件庫了嗎?在allegro裡面setup裡面設定好路徑,然後倒入capture生成的logic。我記得自己寫過一篇部落格,本想連結給你,找不到了,你度娘哈方法很多的。
7樓:青青河邊草
就是庫沒設定好啦,你吧庫的路徑設定好了就可以了
cadence匯入網表時出現錯誤提示如下: 怎麼解決
8樓:匿名使用者
你好,你和我遇到的問題一樣,你這是軟體版本低的問題,我之前也是遇見這問題,庫路徑,環境變數都設定好還是不行。解決方法:1.
打補丁,網上有教程網頁連結。2.安裝高版本軟體。
希望能夠幫助你。希望採納我的答案。
cadence 原理圖匯出網表失敗,出現如下錯誤怎麼解決? 封裝都是新增好了的,也通過了drc檢查。
9樓:匿名使用者
1,封裝的路徑設定是否正確?包含pad。
2,嘗試把「v1.0」資料夾重新命名試看看,把點去掉。
allegro 匯入網表時候出錯,哪位大神幫忙解決
10樓:匿名使用者
網表是有3個檔案的,你是否全部copy了?
出現這個問題是說明1/3的網表出錯了!或者是原理圖那裡就沒把網表導全!
所以你要檢查的是原理圖匯出網表的這個過程中有沒有出錯!如果有錯誤,修改之。
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